EP2S30F484C3N FPGA -システム内プログラム可能なゲート・アレーFPGA - Stratix II 1694実験室342 IOs

                                                    EP2S30F484C3Nのデータ用紙

プロダクト細部

[Altera]

導入

Stratix® II FPGA家族は1.2-V、90 nmの全層の銅SRAMプロセスに基づき、性能を最大にする特色にし、そして180,000の同等の論理素子（LEs）に近づく装置密度を可能にする新しい論理構造を。Stratix II装置は要求のためのオン破片の9つまでMbits、TriMatrix™の記憶、記憶集中的な適用提供し、高性能フィルターおよび他のDSP機能の有効な実施のための384までの（18ビット× 18ビット）乗数の96までのDSPのブロックを備えている。

特徴

Stratix II家族は次の特徴を提供する:
■15,600への179,400同等のLEs;表1-1を見なさい
■新しく、革新的な適応性がある論理モジュール（ALM）、Stratix IIの建築の基礎部品構造は、性能およびリソース使用の効率を最大にする
■論理資源を減らさないで利用できる9,383,040 RAMビットまで（1,172,880バイト）
■本当のデュアル ポートの記憶および先入れ/先出し最初の（先入れ先出し法）緩衝を実行する3つのRAMのブロック サイズから成っているTriMatrixの記憶
■高速DSPのブロックは乗数の熱心な実施を（450までのMHzで）提供したり、機能および有限なインパルス応答（もみ）フィルターを増加集める
■装置地域ごとの24の時間を記録する資源が付いている16個までの全体的な時計
■時計のコントロール・ブロックはユーザー モードのパワー消費量を減らすために時計ネットワークが動力を与えるようにする動的時計ネットワークを有効または無効になる支える、
■装置ごとの12までPLLs （4つPLLsをおよび8速いPLLsは高めた）スペクトラム拡散、プログラム可能な帯域幅、時計の切換え、実時間PLL再構成、および高度の乗法および段階の転移を提供する
■多数の片端接地および差動入力/出力の標準のためのサポート
■1 Gbps性能のためのDPAの回路部品が付いている高速差動入力/出力サポート
■平行RapidIOを含む高速ネットワーキングおよびコミュニケーション バス標準、SPI-4段階のためのサポート2 （POS-PHYのレベル4）、HyperTransport™の技術およびSFI-4
■DDRを含む高速外的な記憶のためのサポート、およびDDR2 SDRAM、RLDRAM II、QDR II SRAM、およびSDR SDRAM
■Altera MegaCore®機能およびAltera Megafunctionのパートナ プログラム（AMPPSM）のmegafunctionsからの多数の知的財産のmegafunctionsのためのサポート
■構成ビットストリームの暗号化を使用して設計保証のためのサポート
■遠隔構成の更新のためのサポート

指定

形態、パッケージ、機能多用性がある部品

記述

だれ私達はあるか。

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FAQ
Q:あなた商事会社または製造業者はであるか。
:私達は集積回路の破片の元の製造業者である。私達はOEM/ODMビジネスをしてもいい。
Q:どの位あなたの受渡し時間はあるか。
:グループの購買の受渡し時間:30-60日;概要の受渡し時間:20日。
Q:あなたの支払い条件は何であるか。
:沈殿物としてT/T 30%、および配達の前の70%。
Q:あなたのプロダクトを買う方法か。
:私達の会社からのプロダクトを直接買うことができる。通常プロシージャはあなたの国に配達に印契約、T/Tによる支払、連絡する運送会社に商品である。Q:保証は何であるか。
:自由な保証は修飾される依託の日からの1年ある。自由な保証期間内の私達のプロダクトのための欠陥があれば、私達はそれを修理し、自由のための欠陥アセンブリを変える