[Altera]
La famille de Stratix® II FPGA est basée sur un 1.2-V, 90 nanomètre, processus de SRAM d'en cuivre de tout-couche et comporte une nouvelle structure de logique qui maximise la représentation, et permet des densités de dispositif approchant 180 000 éléments logiques équivalents (LEs). Les dispositifs de Stratix II offrent jusqu'à 9 Mbits de la sur-puce, mémoire de TriMatrix™ pour exiger, applications intensives de mémoire et ont jusqu'à 96 blocs de DSP avec jusqu'à 384 (18-bit multiplicateurs de bit de × 18) pour l'exécution efficace des filtres de haute performance et d'autres fonctions de DSP.
La famille de Stratix II offre les caractéristiques suivantes :
■15 600 à 179 400 LEs équivalent ; voir le tableau 1-1
■Le nouveau et innovateur module de logique adaptatif (ALM), le bloc fonctionnel de base de l'architecture de Stratix II, maximise la représentation et l'efficacité d'utilisation de ressource
■Jusqu'à 9 383 040 bits de RAM (1 172 880 octets) disponibles sans réduire des ressources de logique
■Mémoire de TriMatrix se composant de trois longueurs de bloc de RAM pour mettre en application la véritable mémoire à double accès et les premiers- tampons (fifo) à système premier entré, premier sorti
■Les blocs ultra-rapides de DSP fournissent l'exécution consacrée des multiplicateurs (à jusqu'à 450 mégahertz), multiplier-accumulent des fonctions, et des filtres finis de réponse d'impulsion (SAPIN)
■Jusqu'à 16 horloges globales avec 24 ressources de synchronisation par région de dispositif
■Les blocs de gestion d'horloge soutiennent le réseau dynamique d'horloge activer/, qui permet à des réseaux d'horloge de mettre hors tension pour réduire la puissance en mode d'utilisateur
■Jusqu'à 12 PLLs (quatre ont augmenté PLLs et huit PLLs rapide) par dispositif fournissent le spectre étalé, la largeur de bande programmable, le changement d'horloge, la reconfiguration en temps réel de PLL, et la multiplication avancée et déphaseur
■Soutien de nombreuses normes assymétriques et différentielles d'entrée-sortie
■Appui différentiel ultra-rapide d'entrée-sortie avec des circuits de DPA pour la représentation 1-Gbps
■Soutien des normes de canal ultra-rapides de mise en réseau et de communications comprenant RapidIO parallèle, SPI-4 phase 2 (technologie de niveau 4), de HyperTransport™ de POS-PHY, et SFI-4
■Soutien de mémoire externe ultra-rapide, y compris la RDA et le DDR2 SDRAM, le RLDRAM II, le QDR II SRAM, et le DTS SDRAM
■Soutien des megafunctions multiples de propriété intellectuelle des fonctions d'Altera MegaCore® et des megafunctions du programme d'associés d'Altera Megafunction (AMPPSM)
■Soutien de sécurité de conception utilisant le chiffrage de bitstream de configuration
■Soutien des mises à jour de configuration à distance
Caractéristiques
Attribut | Valeur d'attribut |
---|---|
Fabricant | Intel/Altera |
Catégorie de produit | FPGAs (réseau prédiffusé programmable de champ) |
Série | Stratix® II |
Produit | Stratix II |
Emballage | Plateau |
De style du support | SMD/SMT |
Nom commercial | Stratix II |
Paquet-cas | 484-BBGA, FCBGA |
L'Actionner-température | 0°C | 85°C (TJ) |
De type support | Bâti extérieur |
Tension-approvisionnement | 1,15 V | 1,25 V |
Fournisseur-Dispositif-paquet | 484-FBGA (23x23) |
Nombre d'IC de portes | - |
Nombre-de-JE-o | Entrée-sortie 342 |
Nombre-de-laboratoires-CLBs | 1694 |
Nombre-de-Logique-Élément-cellules | 33880 |
Total-RAM-peu | 1369728 bits |
Température de fonctionnement maximum | + 70 C |
Gamme de température de fonctionnement | 0 C |
Actionner-Approvisionnement-tension | 1,2 V |
Actionner-Approvisionnement-actuel | 0,3 A |
Paquet-cas | FBGA-484 |
Entrée-sortie | Entrée-sortie 342 |
Nombre-de-Logique-Rangée-Bloc-laboratoires | 1694 |
Nombre-de-Logique-éléments | 33880 éléments logiques |
Total-mémoire | bit 1369728 |
Forme, paquet, composant compatible fonctionnel
Descriptions
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