EP1C3T100C6N 프로그램 가능한 논리 IC FPGA - 필드 프로그래머블 게이트 어레이 FPGA - 사이클론 I 291 랩스 65 IOs

                                                                  LCMXO640C-4FTN256C 데이터 시트
제품 상세정보

도입

마흐스오는 전통적으로 크플즈와 저 캐패시티 FPGA에 의해 다루어진 적용을 위한 요구조건을 충족시키기 위해 최적화됩니다 : 글루 로직, 버스 가교, 모선 대면, 전원공급 제어와 제어 논리. 이러한 기기는 단일 칩에 CPLD와 FPGA 기기의 최고 특징을 취합합니다.

특징

무한히 환경을 재설정할 수 있는 비휘발성인 ■
오우 순간 동작 - 마이크로초에서 위로 전원
오우 단일 칩, 어떤 외부 정보 메모리
요구됩니다
오우 우수한 디자인 보안, 그렇게 하기 위한 어떤 비트 스트림
차단
오우는 밀리초에서 SRAM 기반을 둔 논리를 재구성합니다
프로그램 가능한 오우 SRAM과 비휘활성 메모리
JTAG 공항을 통하여
오우 지원 백그라운드 프로그래밍의
비휘활성 메모리
■ 슬립 모드
오우는 최고 100x까지 정적 전류 감소를 허락합니다
■ 트렌스프티엠 재구성 (TFR)
시스템이 운영하는 동안 오우 인필드 논리는 업데이트됩니다
■ 높은 것 입출력 논리 밀도에
2280 LUT4s에 대한 오우 256
광범위한 패키지 옵션과 오우 73 내지 271 I/Os
지원받은 오우 비중 이동
오우 리드 free/RoHS 순응하는 패키징
■는 메모리를 끼워 넣었고 분배했습니다
오우 최고 27.6까지 kbit 시스멤티엠 내장된 블록
RAM
7.5 kbit에 달하는 오우는 RAM을 분배했습니다
오우 헌신적 FIFO 제어 논리
■ 탄력적 입출력 버퍼
오우 프로그램 가능한 사이시오트텀 버퍼 지원 넓입니다
인터페이스의 범위 :
- LVCMOS 3.3/2.5/1.8/1.5/1.2
- LVTTL
- PCI
- LVDS, 버스-LVDS, LVPECL, RSDS
■ 시스클록티엠 피볼스
장치 당 두 아날로그 PLL에 달하는 오우
오우 시계 곱하기와 분할과 위상 쉬프팅
■ 시스템 레벨 지원
오우 IEEE 표준 1149.1 바운더리 스캔
오우 탑승하는 진동자
오우 장치는 3.3V, 2.5V, 1.8V 또는 1.2V와 함께 작동합니다
전원 공급기
오우 IEEE 1532 순응하는 인시스템 프로그래밍
상술

기술

 
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