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| 起源の場所 | 呼出し |
| ブランド名 | Analog Devices |
| 証明 | ROHS |
| モデル番号 | ADCLK944BCPZ |
プロダクト細部
図1の回路は個々のプロダクトのためのそれぞれの評価板の接続によって組み立てられた。一致させたケーブル長の関係はなされた。多数AD9910を合わせる3つの基本条件の第一号は一致した参照クロック（REF CLK）を提供することである。
組み立ては各AD9910 DDSのためにREF CLKの源としてAD9520を使用する。AD9520は外的な水晶および内部PLLを逃げる。AD9520はすべての4枚のAD9910評価板にREF CLKs （PECLの出力）一直線に並ぶ段階を1つのGHzの配る。それはまたIO_UPDATEにTektronix DG2020Aデータ パターン・ジェネレータにCMOSの出力時計を提供する。
多数のDDS装置の同時性は多数の頻度キャリアを渡る段階そして広さの精密なデジタル調整制御を可能にする。このタイプの制御はレーダーの塗布および求積法に有用である（I/Q）側波帯の抑制のためのupconversion。
図1の回路はAD9520クロック発振器を使用して4 AD9910 1 GSPSを、DDSの破片合わせる方法をおよびADCLK846時計のファン・アウト緩衝示す。結果は4つのAD9910装置の時計と出力信号間の精密な段階の直線である。
指定
| 属性 | 属性値 |
|---|---|
| 製造業者 | アナログ・デバイセズ |
| 製品カテゴリ | ICの破片 |
| シリーズ | SiGe |
| タイプ | ファン・アウト緩衝（配分） |
| 包装 | 互い違いの包装 |
| 土台式 | SMD/SMT |
| パッケージ場合 | 16-WFQFNはパッド、CSPを露出した |
| 作動温度 | -40°C | 85°C |
| 土台タイプ | 表面の台紙 |
| 電圧供給 | 2.375 V | 3.63ボルト |
| 製造者装置パッケージ | 16-LFCSP-WQ （3x3） |
| 入力 | CML、CMOS、LVDS、LVPECL |
| 出力 | ECL、LVPECL |
| 数の回路 | 1つの回路 |
| 入るべき出力の比率 | 1899/12/30 1:04:00 |
| 差動入力:出力 | はい/はい |
| 頻度最高 | 7GHz |
| 数の出力 | 8出力 |
| 最高使用可能温度 | + 85 C |
| 実用温度範囲 | - 40 C |
| ソフトウェア開発のキット | ADCLK944/PCBZ |
| 供給電圧最高 | 3.63 V |
| 供給電圧分 | 2.375 V |
| パッケージ場合 | LFCSP-16 |
| 伝播遅れ最高 | 3.3ボルトの0.13 ns |
| 最高出力頻度 | 7つのGHz |
記述
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