Microprocesseurs à semi-conducteurs MC68030FE20C - MPU 32B sur puce

                                                   La feuille de données MC68030FE20C

Spédition

Formulaire, emballage

Détails du produit

Le projet de loi

Le MC68030 est un microprocesseur amélioré de 32 bits de Motorola.
Le MC68030 est un membre de la famille de dispositifs M68000 qui combine un noyau d'unité centrale de traitement (CPU), un cache de données, un cache d'instructions, un contrôleur de bus amélioré,une unité de gestion de la mémoire (MMU) dans un seul dispositif VLSILe processeur est conçu pour fonctionner à des vitesses d'horloge supérieures à 20 MHz.et modes d'adressage polyvalents.
Le MC68030 est un code objet vers le haut compatible avec les membres antérieurs de la famille M68000 et possède les fonctionnalités supplémentaires d'une MMU sur puce, d'un cache de données et d'une interface de bus améliorée.Il conserve l'interface de coprocesseur flexible mise en place dans le MC68020 et fournit une prise en charge complète du point flottant IEEE via cette interface avec le coprocesseur à point flottant MC68881 ou MC68882En outre, les blocs fonctionnels internes de ce microprocesseur sont conçus pour fonctionner en parallèle, ce qui permet l'exécution d'instructions qui se chevauchent.les caches internes, la MMU sur la puce et le contrôleur de bus externe fonctionnent tous en parallèle.

Caractéristiques

Les caractéristiques du microprocesseur MC68030 sont les suivantes:
• Code objet Compatible avec les microprocesseurs MC68020 et M68000 antérieurs
• Bus d'adresses et de données non multiplexés de 32 bits complets
• 16 registres de données et d'adresses à usage général de 32 bits
• Deux pointeurs de superviseur de 32 bits et 10 registres de contrôle à usage spécial
• Le cache d'instructions de 256 octets et le cache de données de 256 octets peuvent être consultés simultanément
• MMU paginée qui traduit les adresses en parallèle avec l'exécution d'instructions et les accès au cache interne
• Deux segments transparents permettent l'accès non traduit à la mémoire physique pour les systèmes qui transférent de grands blocs de données entre des adresses physiques prédéfinies
• L'architecture en pipeline avec un parallélisme accru permet d'accéder aux cache internes en parallèle avec les transferts de bus et l'exécution d'instructions qui se chevauchent
• Le contrôleur de bus amélioré prend en charge les cycles de bus asynchrones (minimum trois heures), les cycles de bus synchrones (minimum deux heures),et les transferts de données instantanés (minimum d'une heure) tous vers l'espace d'adresse physique
• La taille dynamique du bus prend en charge les mémoires et les périphériques de 8, 16 et 32 bits
• Prise en charge des coprocesseurs avec l'interface de coprocesseur M68000, par exemple, prise en charge complète IEEE en virgule flottante fournie par les coprocesseurs en virgule flottante MC68881/MC68882
• Plage d'adressage logique et physique de 4 Go
• Implémenté dans la technologie HCMOS de Motorola qui permet de combiner les portes CMOS et HMOS (High Density NMOS) pour une vitesse maximale, une faible puissance et une taille de matrices optimale.
• Vitesse du processeur supérieure à 20 MHz

Dles dépôts

68030 Microprocesseur IC M680x0 1 noyau, 32 bits 20MHz 132-CQFP (24x24)

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