Fiche technique de SPC560B60L7B6E0X
Détails de produit
Le MPC5607B est une nouvelle famille de prochaine génération que les microcontrôleurs construits sur la puissance Architecture™ ont inclus la catégorie. Ce document décrit les caractéristiques de la famille et des options disponibles chez les membres de la famille, et accentue des caractéristiques électriques et physiques importantes du dispositif.
La famille de MPC5607B des microcontrôleurs à 32 bits est le dernier accomplissement dans les contrôleurs des véhicules à moteur intégrés d'application. Elle appartient à une famille en expansion des produits des véhicules à moteur-focalisés conçus pour adresser la prochaine vague des applications de l'électronique de corps dans le véhicule. Le noyau avancé et rentable de processeur hôte de la famille des véhicules à moteur de contrôleur de MPC5607B est conforme à la catégorie incluse par architecture de puissance et met en application seulement APU de VLE (codage de longueur variable) (unité de processeur d'Auxillary), fournissant la densité améliorée de code. Il fonctionne aux vitesses de jusqu'à 64 mégahertz et offre le traitement de haute performance optimisé pour la consommation de puissance faible. Il profite de l'infrastructure disponible de développement des dispositifs actuels d'architecture de puissance et est soutenu avec des pilotes logiciels, des systèmes d'exploitation et le code de configuration pour assister des réalisations d'utilisateurs.
• Question simple, complexe à 32 bits de noyau d'unité centrale de traitement (e200z0h)
— Conforme avec la puissance Architecture™ a inclus la catégorie
— Jeu d'instructions augmenté permettant le codage de longueur variable (VLE) pour la réduction d'empreinte de pas de nombre d'instructions. Avec le codage facultatif des instructions de 16 bits et à 32 bits mélangées, il est possible de réaliser la réduction significative d'empreinte de pas de nombre d'instructions.
• Éclair de sur-puce de jusqu'à 1,5 Moctets soutenu avec le contrôleur instantané
• Sur-puce SRAM de jusqu'à 96 K bytes
• Unité de protection de la mémoire (MPU) avec 8 descripteurs de région et granularité de région de 32 octets sur certains membres de la famille
• Contrôleur d'interruption (INTC) capable de manipuler 204 sources d'interruption de sélectionnable-priorité
• Boucle à verrouillage déphasé à fréquence modulée (FMPLL)
• Architecture de commutateur à barres croisées pour l'accès concurrent aux périphériques, à l'éclair, ou au RAM des maîtres multiples d'autobus
• contrôleur de l'EDMA de 16 canaux avec des sources multiples de demande de transfert utilisant le multiplexeur de DMA
• Le module d'aide de botte (bam) soutient l'éclair interne programmant par l'intermédiaire d'un lien périodique (BOÎTE ou SCI)
• La minuterie soutient des canaux d'entrée-sortie fournissant une gamme de capture de 16 bits d'entrée, sortie pour comparer, et des fonctions de modulation d'impulsions en largeur (l'eMIOS)
• 2 convertisseurs analogique-numérique (CDA) : un 10 mordus et un 12 mordus
• Unité croisée de déclencheur pour permettre la synchronisation des conversions de CDA avec un événement de chronométreur de l'eMIOS ou du PUITS
• Jusqu'à 6 modules périodiques de l'interface périphérique (DSPI)
• Jusqu'à 10 modules d'interface de communication périodique (LINFlex)
• Jusqu'à 6 ont augmenté de pleins modules de BOÎTE (FlexCAN) avec les tampons configurables
• 1 module d'interface inter-intégré du circuit (I2C)
• Jusqu'à 149 bornes d'usage universel configurables soutenant des opérations d'entrée et sortie (personne à charge de paquet)
• Compteur en temps réel (RTC)
— Source d'horloge des 128 kilohertz internes ou oscillateur de 16 mégahertz soutenant la commande autonome avec 1 résolution de Mme avec le temps mort maximum de 2 secondes
— Soutien facultatif de RTC avec la source d'horloge de l'oscillateur à cristal externe de 32 kilohertz, la commande de soutien avec 1 résolution de sec et le temps mort maximum de 1 heure
• Jusqu'à 8 minuteries périodiques d'interruption (PUITS) avec la contre- résolution à 32 bits
• Interface de développement de connexion (NDI) par classe d'IEEE-ISTO 5001-2003 deux plus
• Essai de dispositif/de balayage frontière de conseil soutenu par groupe d'action commun d'essai (JTAG) d'IEEE (IEEE 1149,1)
• régulateur de tension de Sur-puce (VREG) pour le règlement de l'approvisionnement d'entrée pour tous les niveaux internes
Caractéristiques
Attribut | Valeur d'attribut |
---|---|
Fabricant | STMicroelectronics |
Catégorie de produit | Microcontrôleurs |
Série | SPC56 |
Emballage | Bande et bobine (TR) |
Paquet-cas | 176-LQFP |
L'Actionner-température | -40°C | 105°C (VENTRES) |
Fournisseur-Dispositif-paquet | 176-LQFP (24x24) |
Nombre-de-JE-o | Entrée-sortie 149 |
Vitesse | 64MHz |
EEPROM-taille | - |
Noyau-processeur | e200z0h |
RAM-taille | 80K X 8 |
Mémoire de programme | ÉCLAIR |
Périphériques | DMA, LVD, POR, PWM, WDT |
Connectivité | BOÎTE, I2C, LIN, SCI, SPI, UART/USART |
Tension-approvisionnement-Vcc-Vdd | 3 V | 5,5 V |
Noyau-taille | à 32 bits |
Programme-Mémoire-taille | 1MB (1M x 8) |
Donnée-convertisseurs | A/D 53x10/12b |
De type oscillateur | Interne |
Descriptions
Qui sommes-nous ?
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